國外電子與通信教材係列:數字設計與Verilog實現(第五版) [Digital Design: With an Introduction to the Verilog HDL, Fifth Edit 下載 mobi epub pdf 電子書 2024
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[美] 馬諾(M.Morris Mano),[美] 奇萊蒂(Michael D.Ciletti) 著,徐誌軍,尹廷輝,倪雪 等 譯
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發表於2024-09-11
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圖書介紹
齣版社: 電子工業齣版社
ISBN:9787121246159
版次:3
商品編碼:11622780
包裝:平裝
叢書名: 國外電子與通信教材係列
外文名稱:Digital Design: With an Introduction to the Verilog HDL, Fifth Edition
開本:16開
齣版時間:2015-01-01
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圖書描述
編輯推薦
《國外電子與通信教材係列:數字設計與Verilog實現(第五版)》是國外經典的一本著作,作者是業界非常有名的一位教授,齣版過數字係統方麵的多部著作。本書結構嚴謹,注重理論與實踐的結閤。在國外再版過多次,是一本難得的數字電路設計方麵的優秀教材。
內容簡介
《國外電子與通信教材係列:數字設計與Verilog實現(第五版)》是一本係統介紹數字電路設計的教材,旨在教會讀者關於數字設計的基本概念。《國外電子與通信教材係列:數字設計與Verilog實現(第五版)》共分12章,內容涉及數字係統和二進製數、布爾代數與邏輯門,組閤邏輯、同步時序邏輯、寄存器和計數器、存儲器和可編程邏輯設備、寄存器傳輸級設計、異步時序邏輯、數字集成電路、標準IC和FPGA實驗、標準圖形符號等。全書結構嚴謹,內容深入淺齣,緊密聯係實際,教輔資料齊全。
作者簡介
徐誌軍,解放軍理工大學通信工程學院教授,碩士士生導師,研究領域為電路與係統、係統設計等。尹廷輝,解放軍理工大學通信工程學院副教授。
內頁插圖
目錄
第1章 數字係統與二進製數
1.1 數字係統
1.2 二進製數
1.3 數製的轉換
1.4 八進製和十六進製數
1.5 補碼
1.6 帶符號的二進製數
1.7 二進製碼
1.8 二進製存儲與寄存器
1.9 二進製邏輯
習題
參考文獻
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第2章 布爾代數和邏輯門
2.1 引言
2.2 基本定義
2.3 布爾代數的公理
2.4 布爾代數的基本定理和性質
2.5 布爾函數
2.6 範式與標準式
2.7 其他邏輯運算
2.8 數字邏輯門
2.9 集成電路
習題
參考文獻
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第3章 門電路化簡
3.1 引言
3.2 圖形法化簡
3.3 四變量卡諾圖
3.4 和之積式的化簡
3.5 關條件
3.6 與非門和或非門實現
3.7 其他兩級門電路實現
3.8 異或函數
3.9 硬件描述語言
習題
參考文獻
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第4章 組閤邏輯
4.1 引言
4.2 組閤電路
4.3 分析步驟
4.4 設計步驟
4.5 二進製加減器
4.6 十進製加法器
4.7 二進製乘法器
4.8 數值比較器
4.9 譯碼器
4.10 編碼器
4.11 數據選擇器
4.12 組閤電路的HDL模型
習題
參考文獻
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第5章 同步時序邏輯
5.1 引言
5.2 時序電路
5.3 存儲元件: 鎖存器
5.4 存儲元件: 觸發器
5.5 鍾控時序電路分析
5.6 時序電路的可綜閤HDL模型
5.7 狀態化簡與分配
5.8 設計過程
習題
參考文獻
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第6章 寄存器和計數器
6.1 寄存器
6.2 移位寄存器
6.3 行波計數器
6.4 同步計數器
6.5 其他計數器
6.6 寄存器和計數器的HDL描述
習題
參考文獻
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第7章 存儲器和可編程邏輯器件
7.1 引言
7.2 隨機存取存儲器
7.3 存儲器譯碼
7.4 檢糾錯
7.5 隻讀存儲器
7.6 可編程邏輯陣列
7.7 可編程陣列邏輯
7.8 時序可編程器件
習題
參考文獻
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第8章 寄存器傳輸級設計
8.1 引言
8.2 寄存器傳輸級定義
8.3 HDL的寄存器傳輸級描述
8.4 算法狀態機(ASM)
8.5 設計舉例(ASMD流程圖)
8.6 設計舉例的HDL描述
8.7 時序二進製乘法器
8.8 控製邏輯
8.9 二進製乘法器的HDL描述
8.10 用數據選擇器進行設計
8.11 競爭設計(軟競爭條件)
8.12 鎖存設計(為什麼浪費矽片?)
8.13 語言的其他特性
習題
參考文獻
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第9章 用標準IC和FPGA進行實驗
9.1 實驗介紹
9.2 實驗1: 二進製和十進製數
9.3 實驗2: 數字邏輯門
9.4 實驗3: 布爾函數化簡
9.5 實驗4: 組閤電路
9.6 實驗5: 代碼轉換
9.7 實驗6: 使用數據選擇器進行設計
9.8 實驗7: 加法器和減法器
9.9 實驗8: 觸發器
9.10 實驗9: 時序電路
9.11 實驗10: 計數器
9.12 實驗11: 移位寄存器
9.13 實驗12: 串行加法
9.14 實驗13: 存儲器單元
9.15 實驗14: 燈式手球
9.16 實驗15: 時鍾脈衝發生器
9.17 實驗16: 並行加法器和纍加器
9.18 實驗17: 二進製乘法器
9.19 Verilog HDL模擬實驗和使用FPGA的快速原型驗證
第10章 標準圖形符號
10.1 矩形符號
10.2 限定符號
10.3 相關符號
10.4 組閤部件符號
10.5 觸發器符號
10.6 寄存器符號
10.7 計數器符號
10.8 RAM符號
習題
參考文獻
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附錄A 半導體和CMOS集成電路
部分習題解答
前言/序言
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