數字電路與係統設計/21世紀高等院校信息與通信工程規劃教材 [21st Century University Planned Textbooks of Information and Communic 下載 mobi epub pdf 電子書 2024

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內容簡介

　　《數字電路與係統設計/21世紀高等院校信息與通信工程規劃教材》按照先組閤電路後時序電路、先功能固定器件後功能可編程器件、先電路模塊後係統的思路進行編寫，共分8章。其內容包括數製與碼製、邏輯代數理論及電路實現、組閤邏輯電路、觸發器、時序邏輯電路、可編程邏輯器件、數字係統設計基礎、數模轉換和模數轉換。考慮到硬件描述語言VHDL、Verilog易於自學，因此不單獨設章。將HDL語法規範作為附錄。在各章的最後一節都介紹瞭如何用VHDL描述組閤電路、時序電路等，並貫穿於整個教材，達到強化文本方式和描述硬件電路的目的。集成門電路的分類及其邏輯電平也在附錄中做瞭簡要說明。
　　《數字電路與係統設計/21世紀高等院校信息與通信工程規劃教材》可作為高等院校電子信息類、電氣類、自動化類和計算機類等各專業“數字電路與邏輯設計”或“數字電子技術”課程的教材和教學參考書，也可作為相關工程技術人員的參考書。

內頁插圖

目錄

1 數製與碼製
1.1 數字信號與數字電路概述
1.1.1 數字信號
1.1.2 數字電路與係統
1.2 數製
1.2.1 數製的基本知識
1.2.2 常用數製
1.2.3 數製轉換
1.3 碼製
1.3.1 二進製碼
1.3.2 二一十進（BCD）碼製
1.4 算術運算與邏輯運算
1.4.1 算術運算
1.4.2 邏輯運算
1.5 HDL
習題

2 邏輯代數理論及電路實現
2.1 邏輯代數中的運算
2.1.1 基本邏輯及運算
2.1.2 復閤邏輯運算
2.2 邏輯運算的電路實現
2.2.1 場效應管的開關特性
2.2.2 CMOS反相器
2.2.3 其他類型的CMOS門電路
2.3 邏輯運算的公式
2.3.1 基本公式
2.3.2 常用公式
2.4 邏輯運算的基本規則
2.4.1 代入規則
2.4.2 反演規則
2.4.3 對偶規則
2.5 邏輯函數的標準形式
2.6 邏輯函數的化簡
2.6.1 公式法化簡
2.6.2 卡諾圖法化簡
2.7 VHDL描述邏輯門電路
習題

3 組閤邏輯電路
3.1 SSI構成的組閤電路的分析和設計
3.1.1 組閤邏輯電路的分析
3.1.2 組閤邏輯電路的設計
3.2 常用中規模集成組閤邏輯電路（MSI）
3.2.1 編碼器
3.2.2 譯碼器
3.2.3 數據選擇器
3.2.4 數據比較器
3.2.5 全加器
3.2.6 基於MSI的組閤電路的設計
3.3 競爭和冒險
3.3.1 競爭和冒險的概念
3.3.2 冒險的判彆方法
3.3.3 冒險的消除方法
3.4 VHDL描述組閤邏輯電路
習題

4 觸發器
4.1 概述
4.2 基本SRFF
4.3 鍾控電位觸發器
4.3.1 鍾控SR觸發器
4.3.2 鍾控D觸發器
4.4 邊沿觸發器
4.4.1 DFF
4.4.2 JKFF
4.4.3 TFF和T’FF
4.5 集成觸發器的參數
4.6 觸發器應用舉例
4.7 VHDL描述觸發器
習題

5.時序邏輯電路
5.1 概述
5.2 寄存器
5.2.1 移位寄存器工作原理
5.2.2 MSI移位寄存器
5.3 計數器
5.3.1 同步計數器的分析
5.3.2 同步計數器的設計
5.3.3 MSI同步計數器
5.3.4 異步計數器的分析和設計
5.3.5 移存型計數器
5.4 序列信號發生器
5.5 順序脈衝發生器
5.6 一般時序邏輯電路的分析
5.7 一般同步時序電路的設計
5.8 VHDL描述時序邏輯電路
習題

6 可編程邏輯器件
6.1 PLD概述
6.1.1 PLD的錶示方法
6.1.2 可編程功能的實現
6.1.3 PLD的製造工藝
6.1.4 PLD的分類
6.1.5 PLD的開發流程
6.2 可編程隻讀存儲器（PROM）
6.2.1 PROM的結構和功能
6.2.2 ROM的應用
6.3 可編程邏輯陣列（PLA）和可編程陣列邏輯（PAL）
6.3.1 PLA的結構與應用
6.3.2 PAL的結構與應用
6.4 通用程陣列邏輯（GAL）
6.4.1 GAL的結構
6.4.2 GAL的應用
6.5 復雜可編程邏輯器件（CPLD）
6.5.1 CPLD的産生
6.5.2 CPLD的結構
6.6 現場可編程門陣列（FPGA）
6.6.1 FPGA的産生背景
6.6.2 FPGA的結構
6.7 HDPLD應用舉例
習題

7 數字係統設計基礎
7.1 概述
7.1.1 數字係統的基本模型
7.1.2 同步數字係統時序約定
7.1.3 數字係統的設計方法
7.2 數字係統的描述工具
7.2.1 寄存器傳輸語言（RTL）
7.2.2 方框圖
7.2.3 算法流程圖
7.2.4 算法狀態機（ASM）圖
7.3 控製器設計
7.4 數字係統設計及VHDL實現
7.4.1 二進製乘法器設計
7.4.2 交通燈管理係統設計
7.4.3 A/D轉換係統設計
習題

8 數模轉換和模數轉換
8.1 數模轉換（D/A）
8.1.1 數模轉換原理
8.1.2 常見的DAC結構
8.1.3 DAC的主要參數和意義
8.1.4 集成DAC及其應用舉例
8.2 模數轉換（A/D）
8.2.1 模數轉換的一般過程
8.2.2 常見的ADC結構
8.2.3 ADC的主要參數和意義
8.2.4 集成ADC及其應用舉例
習題
附錄A VHDL簡介
附錄B VERILOG簡介
附錄C 集成門電路及邏輯電平
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