发表于2024-12-27
图书基本信息 | |
图书名称 | Verilog HDL数字集成电路设计原理与应用 |
作者 | 蔡觉平 |
定价 | 35.00元 |
出版社 | 西安电子科技大学出版社 |
ISBN | 9787560641102 |
出版日期 | 2016-08-01 |
字数 | |
页码 | |
版次 | 2 |
装帧 | 平装 |
开本 | 16开 |
商品重量 | 0.4Kg |
内容简介 | |
作者简介 | |
目录 | |
章 Verilog HDL数字集成电路设计方法概述 1 1.1 数字集成电路的发展和设计方法的演变 1 1.2 硬件描述语言 3 1.3 Verilog HDL的发展和国际标准 3 1.4 Verilog HDL和VHDL 5 1.5 Verilog HDL在数字集成电路设计中的优点 6 1.6 功能模块的可重用性 8 1.7 IP核和知识产权保护 9 1.8 Verilog HDL在数字集成电路设计流程中的作用 10 本章小结 11 思考题和习题 11 第2章 Verilog HDL基础知识 12 2.1 Verilog HDL的语言要素 12 |
编辑推荐 | |
文摘 | |
序言 | |
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